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निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब फॉर्मूला

Fx प्रतिलिपि

LaTeX प्रतिलिपि

आउटपुट के निम्न से उच्च में संक्रमण के लिए समय से तात्पर्य किसी उपकरण या सर्किट के आउटपुट टर्मिनल पर सिग्नल द्वारा निम्न वोल्टेज स्तर से उच्च वोल्टेज स्तर में संक्रमण के लिए लिया गया समय है। FAQs जांचें

ζ PLH = (\frac{C load}{K p \cdot (V DD - | V T,p |)}) \cdot ((\frac{2 \cdot | V T,p |}{V DD - | V T,p |}) + \ln ((4 \cdot \frac{V DD - | V T,p |}{V DD}) - 1))

ζ_PLH - आउटपुट के निम्न से उच्च में परिवर्तन का समय?C_load - इन्वर्टर CMOS लोड कैपेसिटेंस?K_p - पीएमओएस का ट्रांसकंडक्टेंस?V_DD - वोल्टेज आपूर्ति?V_T,p - बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज?

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब उदाहरण

मूल्यों के साथ

इकाइयों के साथ

केवल उदाहरण

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब समीकरण मूल्यों के साथ जैसा दिखता है।

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब समीकरण इकाइयों के साथ जैसा दिखता है।

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब समीकरण जैसा दिखता है।

0.0068 = (\frac{0.93}{80 \cdot (3.3 - | -0.9 |)}) \cdot ((\frac{2 \cdot | -0.9 |}{3.3 - | -0.9 |}) + \ln ((4 \cdot \frac{3.3 - | -0.9 |}{3.3}) - 1))

0.0068ns = (\frac{0.93fF}{80µA/V² \cdot (3.3V - | -0.9V |)}) \cdot ((\frac{2 \cdot | -0.9V |}{3.3V - | -0.9V |}) + \ln ((4 \cdot \frac{3.3V - | -0.9V |}{3.3V}) - 1))

0.0068 = (\frac{0.93}{80 \cdot (3.3 - | -0.9 |)}) \cdot ((\frac{2 \cdot | -0.9 |}{3.3 - | -0.9 |}) + \ln ((4 \cdot \frac{3.3 - | -0.9 |}{3.3}) - 1))

बख्शीश: इनपुट मान और इकाइयों को संपादित करने के लिए ऊपर दिए गए पेंसिल ( Pencil

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सीएमओएस डिज़ाइन और अनुप्रयोग » fx निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब समाधान

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब की गणना कैसे करें, इसके लिए हमारे चरण-दर-चरण समाधान का पालन करें।

पहला कदम सूत्र पर विचार करें

ζ PLH = (\frac{C load}{K p \cdot (V DD - | V T,p |)}) \cdot ((\frac{2 \cdot | V T,p |}{V DD - | V T,p |}) + \ln ((4 \cdot \frac{V DD - | V T,p |}{V DD}) - 1))

अगला कदम चरों के प्रतिस्थापन मान

∴

ζ PLH = (\frac{0.93fF}{80µA/V² \cdot (3.3V - | -0.9V |)}) \cdot ((\frac{2 \cdot | -0.9V |}{3.3V - | -0.9V |}) + \ln ((4 \cdot \frac{3.3V - | -0.9V |}{3.3V}) - 1))

अगला कदम इकाइयों को परिवर्तित करें

∴

ζ PLH = (\frac{9.3E-16F}{8E-5A/V² \cdot (3.3V - | -0.9V |)}) \cdot ((\frac{2 \cdot | -0.9V |}{3.3V - | -0.9V |}) + \ln ((4 \cdot \frac{3.3V - | -0.9V |}{3.3V}) - 1))

अगला कदम मूल्यांकन के लिए तैयार रहें

∴

ζ PLH = (\frac{9.3E-16}{8E-5 \cdot (3.3 - | -0.9 |)}) \cdot ((\frac{2 \cdot | -0.9 |}{3.3 - | -0.9 |}) + \ln ((4 \cdot \frac{3.3 - | -0.9 |}{3.3}) - 1))

अगला कदम मूल्यांकन करना

∴

ζ PLH = 6.76491283010572E-12s

अगला कदम आउटपुट की इकाई में परिवर्तित करें

∴

ζ PLH = 0.00676491283010572ns

अंतिम चरण उत्तर को गोल करना

∴

ζ PLH = 0.0068ns

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब FORMULA तत्वों

चर

कार्य

आउटपुट के निम्न से उच्च में परिवर्तन का समय

प्रतीक: ζ_PLH

माप: समयइकाई: ns

टिप्पणी: मान 0 से अधिक होना चाहिए.

आउटपुट के निम्न से उच्च में परिवर्तन का समय खोजने के लिए सूत्र

इन्वर्टर CMOS लोड कैपेसिटेंस

इन्वर्टर CMOS लोड कैपेसिटेंस, CMOS इन्वर्टर के आउटपुट द्वारा संचालित कैपेसिटेंस है, जिसमें वायरिंग, कनेक्टेड गेट्स की इनपुट कैपेसिटेंस और पैरासिटिक कैपेसिटेंस शामिल हैं।

प्रतीक: C_load

माप: समाईइकाई: fF

टिप्पणी: मान 0 से अधिक होना चाहिए.

इन्वर्टर CMOS लोड कैपेसिटेंस खोजने के लिए सूत्र

पीएमओएस का ट्रांसकंडक्टेंस

पीएमओएस का ट्रांसकंडक्टन्स, आउटपुट ड्रेन धारा में परिवर्तन और इनपुट गेट-सोर्स वोल्टेज में परिवर्तन के अनुपात को संदर्भित करता है, जब ड्रेन-सोर्स वोल्टेज स्थिर होता है।

प्रतीक: K_p

माप: ट्रांसकंडक्शन पैरामीटरइकाई: µA/V²

टिप्पणी: मान 0 से अधिक होना चाहिए.

पीएमओएस का ट्रांसकंडक्टेंस खोजने के लिए सूत्र

वोल्टेज आपूर्ति

आपूर्ति वोल्टेज से तात्पर्य किसी विद्युत स्रोत द्वारा विद्युत परिपथ या उपकरण को प्रदान किए जाने वाले वोल्टेज स्तर से है, जो विद्युत प्रवाह और संचालन के लिए विभवांतर के रूप में कार्य करता है।

प्रतीक: V_DD

माप: विद्युतीय संभाव्यताइकाई: V

टिप्पणी: मान 0 से अधिक होना चाहिए.

वोल्टेज आपूर्ति खोजने के लिए सूत्र

बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज

बॉडी बायस के साथ पीएमओएस के थ्रेसहोल्ड वोल्टेज को पीएमओएस के लिए न्यूनतम आवश्यक गेट वोल्टेज के मूल्य के रूप में परिभाषित किया गया है जब सब्सट्रेट जमीन की क्षमता पर नहीं है।

प्रतीक: V_T,p

माप: विद्युतीय संभाव्यताइकाई: V

टिप्पणी: मान -5 से 5 के बीच होना चाहिए.

बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज खोजने के लिए सूत्र

प्राकृतिक लघुगणक, जिसे आधार e का लघुगणक भी कहा जाता है, प्राकृतिक घातांकीय फलन का व्युत्क्रम फलन है।

वाक्य - विन्यास: ln(Number)

abs

किसी संख्या का निरपेक्ष मान, संख्या रेखा पर शून्य से उसकी दूरी होती है। यह हमेशा एक सकारात्मक मान होता है, क्योंकि यह किसी संख्या की दिशा पर विचार किए बिना उसके परिमाण को दर्शाता है।

वाक्य - विन्यास: abs(Number)

सीएमओएस इनवर्टर श्रेणी में अन्य सूत्र

जाना हाई सिग्नल सीएमओएस के लिए शोर मार्जिन

N MH = V OH - V IH

जाना सममित सीएमओएस के लिए अधिकतम इनपुट वोल्टेज

V IL(sym) = \frac{3 \cdot V DD + 2 \cdot V T0,n}{8}

जाना थ्रेसहोल्ड वोल्टेज सीएमओएस

V th = \frac{V T0,n + \sqrt{\frac{1}{K r}} \cdot (V DD + (V T0,p))}{1 + \sqrt{\frac{1}{K r}}}

जाना अधिकतम इनपुट वोल्टेज CMOS

V IL = \frac{2 \cdot V output + (V T0,p) - V DD + K r \cdot V T0,n}{1 + K r}

और देखें

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब का मूल्यांकन कैसे करें?

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब मूल्यांकनकर्ता आउटपुट के निम्न से उच्च में परिवर्तन का समय, निम्न से उच्च आउटपुट संक्रमण के लिए प्रसार विलंब CMOS, CMOS डिवाइस के आउटपुट टर्मिनल पर सिग्नल को निम्न वोल्टेज स्तर से उच्च वोल्टेज स्तर पर संक्रमण करने में लगने वाले समय को संदर्भित करता है। इस देरी में CMOS सर्किट के भीतर गेट देरी और इंटरकनेक्ट देरी जैसे विभिन्न कारक शामिल हैं। का मूल्यांकन करने के लिए Time for Low to High Transition of Output = (इन्वर्टर CMOS लोड कैपेसिटेंस/(पीएमओएस का ट्रांसकंडक्टेंस*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))))*(((2*abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज)))+ln((4*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/वोल्टेज आपूर्ति)-1)) का उपयोग करता है। आउटपुट के निम्न से उच्च में परिवर्तन का समय को ζ_PLH प्रतीक द्वारा दर्शाया जाता है।

इस ऑनलाइन मूल्यांकनकर्ता का उपयोग करके निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब का मूल्यांकन कैसे करें? निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब के लिए इस ऑनलाइन मूल्यांकनकर्ता का उपयोग करने के लिए, इन्वर्टर CMOS लोड कैपेसिटेंस (C_load), पीएमओएस का ट्रांसकंडक्टेंस (K_p), वोल्टेज आपूर्ति (V_DD) & बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज (V_T,p) दर्ज करें और गणना बटन दबाएं।

FAQs पर निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब ज्ञात करने का सूत्र क्या है?

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब का सूत्र Time for Low to High Transition of Output = (इन्वर्टर CMOS लोड कैपेसिटेंस/(पीएमओएस का ट्रांसकंडक्टेंस*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))))*(((2*abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज)))+ln((4*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/वोल्टेज आपूर्ति)-1)) के रूप में व्यक्त किया जाता है। यहाँ एक उदाहरण दिया गया है- 6.2E+6 = (9.3E-16/(8E-05*(3.3-abs((-0.9)))))*(((2*abs((-0.9)))/(3.3-abs((-0.9))))+ln((4*(3.3-abs((-0.9)))/3.3)-1)).

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब की गणना कैसे करें?

इन्वर्टर CMOS लोड कैपेसिटेंस (C_load), पीएमओएस का ट्रांसकंडक्टेंस (K_p), वोल्टेज आपूर्ति (V_DD) & बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज (V_T,p) के साथ हम निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब को सूत्र - Time for Low to High Transition of Output = (इन्वर्टर CMOS लोड कैपेसिटेंस/(पीएमओएस का ट्रांसकंडक्टेंस*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))))*(((2*abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज)))+ln((4*(वोल्टेज आपूर्ति-abs(बॉडी बायस के साथ पीएमओएस का थ्रेसहोल्ड वोल्टेज))/वोल्टेज आपूर्ति)-1)) का उपयोग करके पा सकते हैं। यह सूत्र प्राकृतिक लघुगणक (ln), निरपेक्ष (एब्स) फ़ंक्शन का भी उपयोग करता है.

क्या निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब ऋणात्मक हो सकता है?

{हां या नहीं}, समय में मापा गया निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब ऋणात्मक {हो सकता है या नहीं हो सकता}।

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब को मापने के लिए किस इकाई का उपयोग किया जाता है?

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब को आम तौर पर समय के लिए नैनोसेकंड[ns] का उपयोग करके मापा जाता है। दूसरा[ns], मिलीसेकंड[ns], माइक्रोसेकंड[ns] कुछ अन्य इकाइयाँ हैं जिनमें निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब को मापा जा सकता है।

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निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब फॉर्मूला

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब उदाहरण

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब समाधान

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब FORMULA तत्वों

सीएमओएस इनवर्टर श्रेणी में अन्य सूत्र

निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब का मूल्यांकन कैसे करें?

FAQs पर निम्न से उच्च आउटपुट संक्रमण CMOS के लिए प्रसार विलंब

Variable Name