L'évaluateur Retard de propagation pour les CMOS de transition de sortie haute à basse utilise Time for High to Low Transition of Output = (Capacité de charge CMOS de l'onduleur/(Transconductance du NMOS*(Tension d'alimentation-Tension de seuil du NMOS avec polarisation corporelle)))*((2*Tension de seuil du NMOS avec polarisation corporelle/(Tension d'alimentation-Tension de seuil du NMOS avec polarisation corporelle))+ln((4*(Tension d'alimentation-Tension de seuil du NMOS avec polarisation corporelle)/Tension d'alimentation)-1)) pour évaluer Temps de transition de haut en bas de la sortie, Le délai de propagation pour la transition de sortie haute à basse CMOS fait référence au temps nécessaire à un signal à la borne de sortie d'un dispositif CMOS pour passer d'un niveau de tension élevé à un niveau de tension faible. Cela inclut les retards causés par les portes logiques, les interconnexions et les capacités parasites. Temps de transition de haut en bas de la sortie est désigné par le symbole ζPHL.
Comment évaluer Retard de propagation pour les CMOS de transition de sortie haute à basse à l'aide de cet évaluateur en ligne ? Pour utiliser cet évaluateur en ligne pour Retard de propagation pour les CMOS de transition de sortie haute à basse, saisissez Capacité de charge CMOS de l'onduleur (Cload), Transconductance du NMOS (Kn), Tension d'alimentation (VDD) & Tension de seuil du NMOS avec polarisation corporelle (VT,n) et appuyez sur le bouton Calculer.